1nmが見えてきたスケーリング 「VLSI 2020」リポート 図8:1nmノードを想定しているCOMPLEMENTARY FET(CFET) 出典:Sujith Subramanian, imec, “First Monolithic Integration of 3D Complementary FET (CFET) on 300mm Wafers”, VLSI 2020, TH3.1(クリックで拡大) 記事に戻る 湯之上隆(微細加工研究所),EE Times Japan